隨著信號(hào)處理、視覺(jué)影像處理和控制系統(tǒng)算法的復(fù)雜度不斷增加，在FPGA板上對(duì)硬件實(shí)現(xiàn)進(jìn)行仿真，可以幫助驗(yàn)證設(shè)計(jì)在其系統(tǒng)環(huán)境中的工作情況。
MathWorks發(fā)布新的HDL Verifier功能，可用來(lái)加快FPGA在環(huán)（FIL）驗(yàn)證。利用新的FIL功能，可以更快地與FPGA板通信，實(shí)現(xiàn)更高的仿真時(shí)鐘頻率?，F(xiàn)在，系統(tǒng)工程師和研究人員可以自信地快速確認(rèn)和驗(yàn)證FPGA設(shè)計(jì)在系統(tǒng)中按預(yù)期方式工作，從而節(jié)省開(kāi)發(fā)時(shí)間。
隨著信號(hào)處理、視覺(jué)影像處理和控制系統(tǒng)
算法的復(fù)雜度不斷增加，在FPGA板上對(duì)硬件實(shí)現(xiàn)進(jìn)行仿真，可以幫助驗(yàn)證設(shè)計(jì)在其系統(tǒng)環(huán)境中的工作情況。用于FIL驗(yàn)證的HDL Verifier自動(dòng)設(shè)置MATLAB和Simulink測(cè)試環(huán)境，并將其與運(yùn)行于FPGA開(kāi)發(fā)板上的設(shè)計(jì)相連接。這有助于實(shí)現(xiàn)在實(shí)際硬件上運(yùn)行的FPGA設(shè)計(jì)的高逼真度協(xié)同仿真，同時(shí)復(fù)用開(kāi)發(fā)階段使用的測(cè)試環(huán)境。
數(shù)學(xué)計(jì)算軟件開(kāi)發(fā)商MathWorks推出的MATLAB是一種用于算法開(kāi)發(fā)、數(shù)據(jù)分析、可視化和數(shù)值計(jì)算的程序設(shè)計(jì)環(huán)境，稱(chēng)為“科學(xué)計(jì)算的語(yǔ)言”。Simulink是一種圖形環(huán)境，可用于對(duì)多領(lǐng)域動(dòng)態(tài)系統(tǒng)和嵌入式系統(tǒng)進(jìn)行仿真和模型化設(shè)計(jì)。
R2016b版允許工程師為其FPGA系統(tǒng)時(shí)鐘指定一個(gè)自定義頻率，時(shí)鐘頻率可比以前使用FIL的時(shí)候快五倍。對(duì)于在以FPGA為目標(biāo)時(shí)使用超頻因子的設(shè)計(jì)，如控制應(yīng)用程序，可以使用較大的數(shù)據(jù)輸出規(guī)模來(lái)提高吞吐量。工程師現(xiàn)在還可以利用FIL（使用PCI Express接口）來(lái)加快MATLAB和Simulink以及Xilinx KC705/VC707和Intel Cyclone V GT/Stratix V DSP開(kāi)發(fā)板之間的通信，仿真速度比千兆以太網(wǎng)快3-4倍。
“隨著電子系統(tǒng)日益復(fù)雜，作為驗(yàn)證步驟，精確地驗(yàn)證設(shè)計(jì)原型變得至關(guān)重要。”MathWorks的產(chǎn)品經(jīng)理Jack Erickson說(shuō)，“現(xiàn)在，HDL Verifier允許工程師在真實(shí)硬件上以現(xiàn)實(shí)的時(shí)鐘頻率快速運(yùn)行設(shè)計(jì)，能夠從MATLAB/Simulink這樣方便的算法開(kāi)發(fā)環(huán)境進(jìn)行FPGA在環(huán)仿真，使硬件設(shè)計(jì)驗(yàn)證大幅簡(jiǎn)化。”
目前MathWorks公司提供的產(chǎn)品家族主要用于汽車(chē)、航空、電子、金融服務(wù)、生物醫(yī)藥以及其他行業(yè)的開(kāi)發(fā)上。另外，MATLAB和Simulink產(chǎn)品在全球多所大學(xué)和教學(xué)機(jī)構(gòu)中被采納為基礎(chǔ)教學(xué)和研究工具。
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