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此前,DNA 100于9月19日在德國(guó)發(fā)布,HiFi 5 DSP于10月31日在美國(guó)發(fā)布。
楷登電子(Cadence)發(fā)布全新VirtualBridge適配器。較傳統(tǒng)RTL仿真,基于虛擬仿真技術(shù)的VirtualBridge適配器可以加速硅前驗(yàn)證階段的軟件初啟。同時(shí),VirtualBridge適配器與傳統(tǒng)在線(In-Circuit)仿真應(yīng)用模式互為補(bǔ)充,通過Cadence Palladium Z1企業(yè)級(jí)仿真平臺(tái),可以讓軟件設(shè)計(jì)師提前3個(gè)月開始進(jìn)行硅前軟件驗(yàn)證工作。
神經(jīng)網(wǎng)絡(luò)的自身架構(gòu)在不斷更新?lián)Q代,新網(wǎng)絡(luò)、新應(yīng)用和新市場(chǎng)也層出不窮,因此業(yè)界亟需一款針對(duì)嵌入式系統(tǒng)量身定制的高性能、通用型神經(jīng)網(wǎng)絡(luò)解決方案,不僅應(yīng)該具備極低的功耗,還應(yīng)擁有高度的可編程能力,以適應(yīng)未來變化,降低風(fēng)險(xiǎn)。
隨著神經(jīng)網(wǎng)絡(luò)越來越復(fù)雜,計(jì)算量越來越龐大,神經(jīng)網(wǎng)絡(luò)的架構(gòu)也不斷發(fā)生變化,因而產(chǎn)生了可用于嵌入式系統(tǒng)的高性能、通用神經(jīng)網(wǎng)絡(luò)處理方案需求。
基于Cadence Protium S1平臺(tái),晶晨加速實(shí)現(xiàn)了軟 硬件(HW SW)集成流程,上市時(shí)間較傳統(tǒng)軟硬件集成工藝縮短 2個(gè)月。
新流程能夠協(xié)助系統(tǒng)單芯片(SoC)設(shè)計(jì)人員于單窗口支持多種制程結(jié)構(gòu)環(huán)境下,快速將全系統(tǒng)的多晶粒及InFO封裝中產(chǎn)生網(wǎng)表
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